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Atefe Dalirsani

M. Sc. Atefe Dalirsani

Name:

M.Sc. Atefe Dalirsani

Address:

University of Stuttgart

Institute of Computer Architecture and

Computer Engineering

Pfaffenwaldring 47

D-70569 Stuttgart

Germany

Room:

3.170

Telephone:

(+49) (0)711 / 685 88 294

Telefax:

(+49) (0)711 / 685 88 288

E-Mail:

 

 

atefe.dalirsani@informatik.uni-stuttgart.de

 

ROCK: Robuste On-Chip-Kommunikation durch hierarchische Online-Diagnose und -Rekonfiguration

Projektseite: Robuste On-Chip-Kommunikation durch hierarchische Online-Diagnose und -Rekonfiguration

Ziel des Projekts ROCK ist es, robuste Architekturen und zugehörige Entwurfsverfahren für Networks-on-Chip (NoC) zu untersuchen und prototypisch zu entwickeln, um der mit steigender Integrationsdichte zunehmenden Störanfälligkeit der On-Chip-Kommunikationsinfrastruktur gegenüber Umgebungsstrahlung, Übersprechen, Fertigungsvariabilitäten und Alterungseinflüssen zu begegnen. Dazu wird ein Ansatz verfolgt, der im Betrieb (online) Fehlerdiagnose und zielgerichtete Rekonfiguration zur Fehlerbehebung in hierarchischer Weise über die Netzwerkschichten durchführt und dabei schichtenübergreifend eine optimale Kombination von Maßnahmen auswählt. Die Optimalität umfasst die energieminimale Einhaltung von Zusicherungen bezüglich der Performability des Netzwerks, welche unter Einbeziehung der Kommunikationsperformanz und der Fehlerstatistik für das Forschungsgebiet der NoCs neu zu definieren ist. Weitere Anforderungen bestehen in der fehlertoleranten Auslegung der Diagnose- und Rekonfigurationssteuerung sowie in ihrer Transparenz für die über das NoC kommunizierenden Anwendungsprozesse. Die NoC-Architekturen und -Verfahren sind bezüglich Optimalität und Randbedingungen auch im Fehlerfall zu bewerten. Diese Bewertung beruht auf zu schaffenden funktionalen Fehlermodellen, welche mit Netzwerkmodellen zu einer NoC-Fehlersimulation integriert werden.

seit 08.2011, DFG-Projekt: WU 245/12-1    

 

Publications:

  • Atefe Dalirsani, Stefan Holst, Melanie Elm, Hans-Joachim Wunderlich, "Structural Test and Diagnosis for Graceful Degradation of NoC Switches," in Journal of Electronic Testing, 2012, doi: 10.1007/s10836-012-5329-9.
  • Atefe Dalirsani, Stefan Holst, Melanie Elm, Hans-Joachim Wunderlich, "Structural Test for Graceful Degradation of NoC Switches," in Proceedings of European Test Symposium (ETS'11), 2011.
  • Atefe Dalirsani, Stefan Holst, Melanie Elm, Hans-Joachim Wunderlich, "Structural Test for Graceful Degradation of NoC Switches," 23. GI/GMM/ITG-Workshop Testmethoden und Zuverlässigkeit von Schaltungen und Systemen (TuZ'11), Passau, Germany, 27.February - 1. March, 2011.
  • Mohammad Hosseinabady, Atefe Dalirsani, Zainalabedin Navabi, "Using the Inter- and Intra-Switch Regularity in NoC Switch Testing," in Proceedings of Design Automation and Test in Europe (DATE'07), 2007.
  • Atefe Dalirsani, Mohammad Hosseinabady, Zainalabedin Navabi, "An Analytical Model for Reliability Evaluation of NoC Architectures," in Proceedings of International On-Line Testing Symposium (IOLTS'07), 2007.
  • Atefe Dalirsani, Z. Navabi, "Testing of Routers in NoC Mesh Architecture Using Router's Functionality," in Proceedings of East-West Design and Test International Symposium (EWDTS'07), 2007.

 

HiWi Job Offer

 

Master Thesis:

Title: Testability of NoC Structures

Advisor: Prof. Zainalabedin Navabi

University of Tehran - CAD Research Group - Dec. 2007

 

 

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